编程快速存储单元的方法 本发明涉及一种编程快速存储单元的方法，特别是涉及一种能减小其尺寸并实现一低功率器件的编程快速存储单元的方法。
通常，诸如一快速电可擦除和可编程只读存储单元(EEPROM)之类的快速存储器件具有电编程和擦除的功能并且依据所构成的栅极电极的形状而被分成叠栅(stack-gate)型和裂栅(split-gate)型。
下面将说明常规的叠栅型和裂栅型快速存储单元的构成和工作。
如图1所示，在该常规叠栅型快速存储单元中，在一硅基片1上顺序叠置有一隧道氧化物膜4、浮置栅5、电介质膜6和控制栅7，并且在该硅基片1中浮置栅5的两侧分别形成源区2和漏区3。上述该快速存储单元地编程和擦除操作如下所述。
为了将一信息编程到该快速存储单元，即将一电荷充入浮置栅5，如图2A所示将+12V加到控制栅7、+5V加到漏区3并且将地电压加到源区2和硅基片1。随后，由于控制栅7加有高电压所以在该硅基片1中在浮置栅5的下面形成了一沟道，并且由于漏区3加有电压所以在该硅基片1中在漏区3侧形成高电场区。此时，在该沟道中所存在的部分电子接收来自高电场区的能量以形成热电子，并且利用由于加到控制栅7的高电压所形成的垂直方向电场而将部分热电子通过该隧道氧化物膜4而注入浮置栅5。因此，由于热电子的注入而使该快速存储单元的阈值电压(VT)以提高。
为了擦除在该快速存储单元中的信息，将在浮置栅5中存储的电荷放电，如图2B所示，将地电压加到控制栅7和硅基片1、+12V加到源区2、并且该漏区3被浮置。随后，由于该F-N(fowler-nordheim)隧道现象注入浮置栅5的电子被移至源区2中，因此该存储单元的阈值电压VT被减小。
通过局部地出现在源区2和浮置栅5之间的该隧道现象而使快速存储单元的擦除操作得以实现。因此，在擦除操作时刻难以控制移至源区2的电子数量，并出现浮置栅5不被电复原的现象，也就是在该隧道氧化膜4的特性变坏的情况下出现过擦除(over erasure)。这种过擦除起了导致该器件的操作特性变坏的作用。
另一方面，在如图3所示的裂栅型快速存储单元中，第一绝缘膜14、浮置栅15、第二绝缘膜16和控制栅17被顺序地层叠在硅基片11上，并且第三绝缘膜18和选择栅19被层叠在包括这种层叠结构的该整体结构上。在浮置栅15下面一侧的硅基片11中形成有漏区13，而在与浮置栅15相距一预定距离的硅基片11中形成有源区12。
下面说明对包括有这种层叠结构的栅电极和一选择晶体管的快速存储单元的编程和擦除的操作。
为了将一信息编程到该快速存储单元，也就是将一电荷充到浮置栅15，如图4A所示将+12V加到控制栅17、+1.8V加到选择栅19、+5V加到漏区13、和将地电压加到源区12及硅基片11。随后，由于加到该选择栅19的电压而在选择栅19下面的硅基片11中形成一选择沟道，并且由于加到控制栅17的高电压而在浮置栅15下面的硅基片11中形成一沟道。20-30μA的漏电流流经该选择沟道并且同时在浮置栅15下面的沟道中形成一高电场区。此时，在该沟道中存在的部分电子接收来自该高电场区的能量从而成为热电子，并且通过由于加到控制栅17的高电压所形成的一垂直方向电场使部分热电子经第一绝缘膜14注入浮置栅15。因此，该快速存储单元的阈值电压VT被提升。
为了擦除在该快速存储单元所编程的信息，也就是，为了使在浮置栅15中所存储的电荷放电，如图4B所示将-12V加到控制栅17、+5V加到漏区13、地电压加到选择栅19和硅基片11、和使源区12浮置。随后，由于该F-N隧道现象而使射入浮置栅15的电子移至源区12，因而该存储单元的阈值电压VT降低。
该裂栅型快速存储单元的读操作是在该选择晶体管被导通的条件下执行的。因而，具有不会出现过擦除现象的优点。但是，因为在选择栅的长度被减小的情况下会出现一漏泄电流，因此该存储单元的尺寸难以减小。
另外，12V或稍高于12V的高电压加到叠栅型和裂栅型快速存储单元的控制栅，并且这种高电压由一电荷抽运电路所提供，该电路将该大约5V的电源电压提升到该高电压。因此，包含有这种存储单元的快速存储单元具有如下的问题，首先需要一长的用于编程的时间并且因为需要较多的时间用于将电源电压提升到该高电压的抽运操作，所以该功耗较大，其次，因为在浮置栅和控制栅之间所形成的第二绝缘膜的厚度必须大于第一绝缘膜的厚度的二倍以上以确保该器件的可靠性，所以给制造过程带来难度。
此外，近来需要一种使用3.3V或2.5V低电压的低功率存储器件，并且提出了一种在编程时降低加到漏区的电压的方法作为实现该低功率存储器件的方法。但是，在使用这种方法的情况下，必须改变该存储单元的结构或漏区连接以保持与使用电源电压(例如5V)的常规存储器件相同水准的编程特性。因此，在制造过程中会出现诸如变化之类的问题并且会出现由于这种变化而增加处理步骤的问题。
另外，在实现低功率存储器件的另外方法中，有一种在该存储器件中增加一电荷抽运电路以便在编程时将加到漏区的电压提升到高于5V的方法。但是，这种方法具有的一个问题是由于在该编程时间会出现30μA或更高的漏电流而不可能通过电荷抽运使漏区电位提高。
因此，本发明的目的是提供一种编程快速存储单元的方法，它可以无须改变裂栅型快速存储单元的结构就可降低快速存储单元的尺寸并且同时还可实现低功率器件。
为了实现上述目的，本发明的一个方面是根据分别加到硅基片、源和漏区、浮置栅、控制栅和选择栅的电压，在一硅基片中所形成的一耗尽区的陷阱中心处所产生的一少数载流子被变为一热电子。
为了实现上述目的，本发明的另一个方面是根据分别加到硅基片、源区、漏区、浮置栅、控制栅和选择栅上的电压，在一源区中所形成的一耗尽区被从硅基片的表面部分延伸到该硅基片的底部，在所延伸的耗尽区处所存在的陷阱中心产生的一少数载流子接收来自选择栅和浮置栅之间的硅基片上所形成的高电场的能量从而变为一热电子。
为实现上述目的，本发明的另一方面是将高于电源电压的一高电压加到控制栅、将该电源电压加到漏区、将低于电源电压而高于地电压的一电压加到选择栅、地电压加到硅基片、和将源区浮置，这样使得在该硅基片上所形成的一耗尽区的陷阱中心所产生的一少数载流子变为一热电子并将该热电子注入浮置栅。
为了实现上述目的，本发明的另一方面是将高于电源电压的一高电压加到控制栅、将高于电源电压而低于该高电压的一电压加到漏区、将低于电源电压而高于地电压的一电压加到选择栅、地电压加到硅基片、和将源区浮置，这样使得在所述硅基片中所形成的耗尽区的陷阱中心产生的一少数载流子变为一热电子。
在阅读了参照如下附图对该实施例所作的详细说明之后，将会对本发明的其它目的和优点有所了解。
图1是常规叠栅型快速存储单元的一截面图；
图2A和2B是说明图1所示的叠栅型快速存储单元编程和擦除操作的截面图；
图3是常规裂栅型快速存储单元的一截面图；
图4A和4B是说明图3所示的裂栅型快速存储单元编程和擦除操作的截面图；
图5是说明根据本发明编程该快速存储单元的方法的一截面图；和
图6A和6B是说明图5的图表。
本发明是对图3所示的编程裂栅型存储单元的常规方法的改进。也就是，常规编程方法使用这样一种方法，在该方法中自该源区飞入的一少数载流子接收来自在该沟道处形成的高电场区的能量以便成为热载流子，并且该热载流子被注入浮置栅(沟道热电子注射法)，但是，本发明的编程方法使用大量(bulk)热电子注射法，在该方法中在该硅基片处形成的一耗尽区所存在的陷阱中心产生一少数载流子并且被变为一热电子以便被注入浮置栅。现在结合图5来说明根据本发明使用大量热电子注射来编程快速存储单元的方法。
图5是说明本发明的编程快速存储单元的方法的截面图，其中，该加速存储单元的整体结构与图3中所示的一般快速存储单元的结构是相同的，因此省略了对其的描述。
首先，为了将一信息编程到该快速存储单元，也就是，为了将一电荷充入浮置栅15，而如图5所示将大约为+5V的电源电压加到漏区13，高于电源电压的大约为+12V的一高电压加到控制栅17，和将地电压加到硅基片11。并且将一低于电源电压但高于地电压的大约为+1.8V的电压加到选择栅19和将源区12置为浮置状态。之后，由于加到控制栅17的高电压而在硅基片11中在浮置栅15的下面形成一沟道20，并且由于加到漏区13的电势而在该沟道20处形成一等电位分布。此时，因为源区12是处于浮置状态，由于该漏区13的高电位势垒而引起的人体电容效应(body effect)使得在硅基片11中该选择栅19下面所形成的选择沟道的阈值电压增加。因此，由于加到选择栅19的电压(+1.8V)不会实现该沟道反型，这样在源区12侧所形成的耗尽区30从硅基片11的表面部分被延伸到其底部。此时，对于该耗尽区30的最大尺寸，被注入源区12的杂质的浓度必须基本上高于注入硅基片11中的杂质的浓度。
在耗尽区30中存在的陷阱中心所产生的一少数载流子的该电子被如此延伸，并且由于加到漏区13的电压所产生的少数载流子接收来自在该硅基片11上选择栅19和浮置栅15之间所形成的高电场区的能量，并被变为一热电子。随后，由于加到控制栅17的高电压所形成的垂直方向的电场，在那里该快速存储单元的阈值电压被提高，热电子通过第一绝缘膜14被注入浮置栅15。
图6A示出了在编程时间根据加到漏区13的电压Vd的变化而使该快速存储单元的阈值电压VTP变化的图表，曲线A表示常规编程方法的阈值电压的变化，曲线B表示了本发明的阈值电压的变化。如图6A中所示，在使用本发明的编程方法的情况下，该编程特性变劣，但是，与使用常规方法所执行的编程操作的情况相比较由于加到漏区13的电压所形成的电场的强度被增加，所以使得编程效率提高。
图6B示出了根据加到选择栅19的电压Vs的变化而使该快速存储单元的阈值电压变化的图表，曲线C表示常规编程方法的阈值电压的变化，曲线D表示本发明的编程方法的阈值电压的变化。如图6B所示，在使用本发明的编程方法的情况下，当电压Vs被加到选择栅19时该编程特性被改善，这是因为随着加到选择栅19的电压的增加而使得耗尽区的尺寸增加以及因为少数载流子的产生率增加的缘故。但是，在加到选择栅19的电压Vs增加到大约为+1.5V或更高的情况下，虽然在选择沟道部分形成的耗尽区的尺寸被增加，但是由于加到漏区13的电压所形成的电场的强度却减小。因此，热电子的产生率迅速减小，因而该编程效率下降。
因此，为了把编程效率和特性提高到最大程度，最好是保持加到选择栅19的电压并通过使用电荷抽运电路提高加到漏区13的电压。根据本发明，因为在编程时间该源区12是被浮置的，不存在有漏电流使得它可使用电荷抽运电路。
另一方面，在将加到漏区13的电压提高到高于电源电压+7V或更高的情况下，如果将高于电源电压的大约+8V到+11V的高电压加到控制栅17则可以获得相同的编程特性，并且在这种情况下，因为加到控制栅17的电压是低于+12V，所以抽运时间减小因而编程时间减小。因此，可以获得减小在控制栅17和浮置栅15之间所形成的第二绝缘膜16的厚度的效果。其结果，如果使用根据本发明的编程快速存储单元的方法，无须改变该裂栅型快速存储单元的结构就能容易地实现低功率器件。
另外，这样被编程的快速存储单元还具有这样的优点，即它可以通过擦除该裂栅型快速存储单元的常规方法而进行擦除，因而省略了擦除该快速存储单元的操作的说明。
如上所述，根据本发明，通过在源区侧所形成的被延伸的耗尽区所存在的陷阱中心产生一少数载流子和通过将所产生的少数载流子接收来自由于加到漏区的电压而在选择栅和浮置栅之间的硅基片处形成的高电场区的能量而成为热电子，并且通过由于加到控制栅的高电压而形成垂直方向电场使该热载子注入该浮置栅，可容易地实现一具有并改善了编程效率和特性的低功率器件并且无须改变该裂栅型快速存储单元的结构就可有效地降低该快速存储单元的尺寸。
在前面的说明中，虽然对具有一定程度特殊性的最佳实施例作了描述，但它仅说明了本发明的原理。应当了解的是本发明并不仅限于在这里所披露和说明的该最佳实施例。因此，在本发明的精神和范围之内的所有适当的变型均作为本发明的进一步的实施例。