本发明一般地说是关于一种新型的微处理机结构。更具体地说，本发明是关于这样的一种微处理机结构，它很容易被选用的设备或外围设备所访问。再进一步明确地说，本发明是关于这样的一种微处理器结构，它使得应用单片微处理机到家用电器上更加容易。 众所周知的微处理机通常由一个中央处理单元（CPU）、一个随机存取存储器（RAM），一个只读存储器（ROM），一个输入/输出（I/O）装置、一个中断控制寄存器、一个定时器等等组成的。对于单片微处理机来说，上述各部份全部装在单块基片上，例如：硅片上。这样的微处理机也常常带有一个或几个不同的外围输入/输出装置，以便形成一个完整的微处理机。
在先有技术中，微处理机结构并没有设计接受各种外围输入/输出装置，这使得它很难于同不同类型外围输入/输出装置相连接。明确地说，为了使这硅片适用于不同的外围设备，微处理机的结构需要很大的变化，因为不同的外围设备需要不同的指令系统、指令译码器和不同配置的RAM和ROM，以适合于新的外围设备。这样的变化需要大量的设计工作和花费很长的时间。这样造成相当高的基片开发费用。
因此，本发明的主要目的就是提供一种新型的微处理机结构，它能够很容易地同各种外围设备相连接。
为了完成上述的目的和其它目的，根据本发明，一种微处理机通常是由一个单片机核心、一个RAM、一个ROM和一个输入/输出选件组成。RAM布置在单片机核心的一边，而ROM设置在单片机核心的另一边。输入/输出选件连接单片机核心和RAM及ROM。该输入/输出选件被设计成能够连接各种外围设备。
在这优选的结构中，单片机核心含有一个CPU和通常用于形成一个完整的微处理机的其它部分。这些公共部份可以包括一个RAM地址寄存器，便于外围设备访问CPU。
根据本发明的一种样式，一个微处理机是这样组成的，包括一个单片机核心，RAM，ROM和一个输入/输出选件。该单片机核心具有第一、第二和第三外围界面，第一和第二外围界面设置在这单片机核心的两边，并由第三晶面连接起来;上述RAM连接在单片机核心的第一外围界面;上述ROM连接在单片机核心的第二外围界面;而输入/输出选件能够同各种外围设备相连接，它连接在单片机核心的第三外围界面以及平行的RAM和ROM外围界面。
单片机核心包含有一个指令译码器，连接在第二外围界面。单片机核心还包含有各种功能块，分别垂直靠近第一和第二外围界面，它们一个挨一个地排列，并且彼此相互平行。
功能块的放置基本上平行于输入/输出选件。功能块包括一个定时器寄存器，还包括一个串行输入/输出寄存器。功能块都有相同位长和基本相同的字节数。
微处理机还包含许多外围输入/输出装置，同输入/输出选件相接，并且RAM有一个地址总线，它也用作为外围输入/输出装置的寻址。
单片机核心有一个RAM地址译码器，用于确定外围输入/输出装置的地址，该RAM地址译码器有地址译码线，延伸到输入/输出选件。
从下面已给出的详细的描述和本发明的最佳实施例的附图，本发明将可以得到更透彻的理解。但是不要把本发明局限于这特定的实施例，这些附图仅仅是用于解释和理解而已。
在这些附图中：
图1表明了根据本发明的一个单片微处理机结构的最佳实施例。
图2表明了图1微处理机的最佳实施例的某些部份的安排。
图3是指令译码器和外围输入/输出装置之间相互连接的示意框图。
现在参看这些附图，特别是图1，一个单片微处理机的最佳实施例包含有RAM1、ROM2、一个程序计算器（PC）3、一个运算器（ALU）6、一个指令寄存器（IR）4、一个指令译码器（PLA）5、一个定时器7、一个串行输入/输出装置8和一个地址寄存器9。程序计算器3、运算器6、指令寄存器4和指令译码器5组成CPU。另外，定时器7、一个串行输入/输出装置8和地址寄存器9同CPU联合形成一个单片机核心10。
就象图1所表明的，上述部份安排在基片11上，例如一个硅片上。RAM1、单片机核心10和ROM2是一个挨一个地排列，RAM1和ROM2排列在单片机核心10的两边。在单片机核心10中，指令寄存器4和指令译码器5连接ROM2于单片机核心10的一个晶面。指令寄存器4和指令译码器5一起组成一个译码器区域。
程序计数器3、运算器6、定时器7、串行输入/输出装置8和地址寄存器9沿着单片机核心10的另一面相互并行地排列。
尽管图上没有表示，但值得欣赏的是工作寄存器、堆栈区域、间接建起数据指针等等都放在RAM1上。
1个输入/输出选件12连接在单片机核心10的一个界面上，也连接于平行的RAM1和ROM2的界面上。这输入/输出选件12是设计来连接一个外围设备或多个设备。
如图2所示，程序计数器3、运算器6、定时器7、串行输入/输出装置8和RAM地址寄存器9都有相同字节数，每字节有相同位数。在结构上，它们有相同的块形式。在这所示的实施例中，每块是由8个单元组成，用于处理8位数据。每块的每个单元同其它块的相应单元相连接，以便输入和输出。由平行的金属线制成的数据总线D1-D8延伸跨过所有块的扫Sin一行的单元。在数据总线中，总线D1-D4被称为偶数据总线，而总线D5-D8被称为奇数据总线。控制线C1-C4从指令译码器4沿着各个相对应的基本上同数据总线相垂直的块3、6、7、8和9延伸。仅仅偶数据总线D1-D4通过信号线S1-S4连接到RAM。
值得欣尝的是，单片机核心10也可以包括附加功能块，例如一个状态标记寄存器、一个暂时寄存器、累加器等等。这些功能块也具有相同的字节和块的大小。假如某些功能块的字节长度比其它功能块或多和或少，这较大块的单元超过标准数部份可以同较小的块连接组成标准块。例如，假定程序计算器3有13位，而状态寄存器有3位，则程序计算器3超额的5位可以同状态寄存器3位联合组成一个8位的功能块。
采用将单片机核心的某些功能块至少排列到相同位数的块和与常规模式相同排列，这样功能块需要的面积最小，部分原因是这样用于连线（例如数据总线、控制线和信号线）的面积较小。
图3表示根据本发明的微处理机结构的另一种实施例。在这种实施例中，访问外围的输入/输出装置，或者单元121……12n的地址是靠用于RAM1的相同总线传递的，这些单元都通过输入/输出选件12连接到微处理机。在这种情况下，连接到指令译码器5的信号线S1-S4（图2）分叉，并与RAM1相并联连接到外围输入/输出单元121-12n。因此，从RAM读出和写入的控制信号可以公用于外围输入/输出单元121-12n。在这种情况下，用地址译码器13来寻址外围输入/输出装置。
对于上述的另一种实施例，RAM的读/写信号一般可以用于外围输入/输出装置。因此，仅仅寻址信号需要用来连接外围输入/输出装置。这意味着仅仅这条地址译码线或一些译码线需要用来同外围设备相连接。
因而，为了同各种外围设备连接，不需要改变单片机核心的结构。而且，当写入软件时、对累加器、RAM等等用来进行算术/逻辑运算、位处理等等的指令都同样适用于所有累加器和共用的输入/输出装置，而用于存取操作数的所有寻址模式也都适用于所有输入/输出装置。这样就为程序设计提供了很大的灵活性。
下面我们将会满意地看到，根据本发明，同各种外围设备相连接将很容易，不需要很大地改变微处理机结构以及（或者）指令系统。因此，本发明达到了前面所追求的所有目的和优点。
当在最佳实施例的条款中公开本发明以便更好地理解本发明时，值得欣尝的是本发明可以用各种方法来实现而不会脱离本发明的原理。因此，本发明应该理解为包括所有可能的实施例和所示实施例的变形。而这些示出的实施例都可能得到实现而不脱离列在附加的权利要求中中的本发明原理。