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1、(10)申请公布号 CN 102932098 A (43)申请公布日 2013.02.13 C N 1 0 2 9 3 2 0 9 8 A *CN102932098A* (21)申请号 201210365398.X (22)申请日 2012.09.27 H04L 1/00(2006.01) H04L 12/861(2013.01) (71)申请人陕西子竹电子有限公司 地址 710077 陕西省西安市高新技术产业开 发区锦业一路72号1幢5层 (72)发明人任小勇 (74)专利代理机构西安西达专利代理有限责任 公司 61202 代理人第五思军 (54) 发明名称 防止电子系统数据传输紊乱的设备 。
2、(57) 摘要 一种防止电子系统数据传输紊乱的设备，经 由内置ARM处理芯片同所述的ARM处理芯片通信 导通的通信协议不兼容触发中断器的中断信号控 制器，ARM处理芯片内设置不兼容通信数据高速 缓存。不会引发通信数据在接收方出现紊乱而导 致通信信息不清楚解析数据包出错的问题。 (51)Int.Cl. 权利要求书1页 说明书1页 附图1页 (19)中华人民共和国国家知识产权局 (12)发明专利申请 权利要求书 1 页 说明书 1 页 附图 1 页 1/1页 2 1.一种防止电子系统数据传输紊乱的设备，内置ARM处理芯片（1）同所述的ARM处理 芯片（1）通信导通的通信协议不兼容触发中断器的中断信。
3、号控制器（2），其特征在于ARM处 理芯片（1）内设置不兼容通信数据高速缓存（3）。 权 利 要 求 书CN 102932098 A 1/1页 3 防止电子系统数据传输紊乱的设备 技术领域 0001 本发明涉及电子技术领域，特别涉及一种防止电子系统数据传输紊乱的设备。 背景技术 0002 现在在电子系统数据传输过程内，由于电子系统内各种设备之间采用的通信信息 不一致，但是为了满足实时通信传输的需求，往往就不顾通信信息的不一致而进行单纯的 传输，这样极易引发通信数据在接收方出现紊乱，导致通信信息不清楚解析数据包出错的 问题。 发明内容 0003 本发明提供一种防止电子系统数据传输紊乱的设备，经由。
4、内置ARM处理芯片同所 述的ARM处理芯片通信导通的通信协议不兼容触发中断器的中断信号控制器，ARM处理芯 片内设置不兼容通信数据高速缓存。不会引发通信数据在接收方出现紊乱而导致通信信息 不清楚解析数据包出错的问题。 0004 为实现上述目的，本发明的技术方案为： 一种防止电子系统数据传输紊乱的设备，内置ARM处理芯片1同所述的ARM处理芯片 1通信导通的通信协议不兼容触发中断器的中断信号控制器2，ARM处理芯片1内设置不兼 容通信数据高速缓存3。 0005 经由内置ARM处理芯片1同所述的ARM处理芯片1通信导通的通信协议不兼容触 发中断器的中断信号控制器2，ARM处理芯片1内设置不兼容通信。
5、数据高速缓存3。不会引 发通信数据在接收方出现紊乱而导致通信信息不清楚解析数据包出错的问题。 附图说明 0006 图1为本发明的连接结构示意图。 具体实施方式 0007 下面经由附图对本发明做进一步说明： 如附图1所示，防止电子系统数据传输紊乱的设备，内置ARM处理芯片1同所述的ARM 处理芯片1通信导通的通信协议不兼容触发中断器的中断信号控制器2，ARM处理芯片1内 设置不兼容通信数据高速缓存3。 0008 经由内置ARM处理芯片1同所述的ARM处理芯片1通信导通的通信协议不兼容触 发中断器的中断信号控制器2，ARM处理芯片1内设置不兼容通信数据高速缓存3。不会引 发通信数据在接收方出现紊乱而导致通信信息不清楚解析数据包出错的问题。 说 明 书CN 102932098 A 1/1页 4 图1 说 明 书 附 图CN 102932098 A 。