可以自动切换启动模式的解码器装置.pdf

上传人:111****112 文档编号:1282400 上传时间:2018-04-12 格式:PDF 页数:7 大小:463.83KB
返回 下载 相关 举报
摘要
申请专利号:

CN201010523541.4

申请日:

2010.10.29

公开号:

CN101986277A

公开日:

2011.03.16

当前法律状态:

授权

有效性:

有权

法律详情:

授权|||实质审查的生效IPC(主分类):G06F 11/16申请日:20101029|||公开

IPC分类号:

G06F11/16; H04N7/26

主分类号:

G06F11/16

申请人:

成都九洲电子信息系统有限责任公司

发明人:

王勤

地址:

610041 四川省成都市高新区天府大道中段765号

优先权:

专利代理机构:

电子科技大学专利中心 51203

代理人:

周永宏

PDF下载: PDF下载
内容摘要

本发明涉及可以自动切换启动模式的解码器装置,包括处理器单元、内存单元和PCI连接器,还包括总线开关单元和存储器单元,所述总线开关单元通过EMIFA总线和处理器单元联结实现通信,通过Flash总线和存储器单元联结实现通信,通过PCI总线和PCI连接器连接实现通信,所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接用以控制总线开关单元与存储器单元和PCI连接器通信的开断,所述PCI信号检测线具有连接有电阻的高电平端。本发明的有益效果是:在单独供电的情况下可以单独启动解码器,从而可以单独对解码器进行调试或软件升级,以排除解码器本身的问题。

权利要求书

1: 可以自动切换启动模式的解码器装置, 包括处理器单元、 内存单元和 PCI 连接器, 其 特征在于, 还包括总线开关单元和存储器单元, 所述总线开关单元通过 EMIFA 总线和处理 器单元联结实现通信, 通过 Flash 总线和存储器单元联结实现通信, 通过 PCI 总线和 PCI 连 接器连接实现通信, 所述 PCI 连接器引出有一根 PCI 信号检测线和总线开关单元连接用以 控制总线开关单元与存储器单元和 PCI 连接器通信的开断, 所述 PCI 信号检测线具有连接 有电阻的高电平端。
2: 根据权利要求 1 所述的可以自动切换启动模式的解码器装置, 所述总线开关单元具 有三个控制端, 其中两个控制端分别为高电平和低电平, 一个控制端与 PCI 连接器连接, 当 PCI 连接器与 PCI 主机连接时 PCI 连接器输出低电平, 当 PCI 连接器与 PCI 主机断开时 PCI 连接器输出高电平, 从而用以控制总线开关单元与存储器单元和 PCI 连接器通信的开断。

说明书


可以自动切换启动模式的解码器装置

    【技术领域】
     本发明属于通信技术领域, 尤其涉及解码器技术领域。背景技术 解码器则包括视频解码器和音频解码器。 目前, 通常的解码器, 一般将解码器的启 动程序存放在 PCI(Peripheral Component Interconnect, 外围组件互联接口标准 ) 主机 的驱动程序中, 而没有在解码器内部设置用于解码器的启动程序备份的存储器。 这样, 一旦 PCI 主机出现故障或者 PCI 驱动程序被破坏, 解码器的启动程序将完全丢失, 使解码器不能 单独进行维修和调试。
     发明内容
     本发明的目的是为了克服现有的解码器不能单独启动的不足, 提出了可以自动切 换启动模式的解码器装置。
     本发明的技术方案是 : 可以自动切换启动模式的解码器装置, 包括处理器单元、 内 存单元和 PCI 连接器, 其特征在于, 还包括总线开关单元和存储器单元, 所述总线开关单元 通过 EMIFA 总线和处理器单元联结实现通信, 通过 Flash 总线和存储器单元联结实现通信, 通过 PCI 总线和 PCI 连接器连接实现通信, 所述 PCI 连接器引出有一根 PCI 信号检测线和总 线开关单元连接用以控制总线开关单元与存储器单元和 PCI 连接器通信的开断, 所述 PCI 信号检测线具有连接有电阻的高电平端。
     所述总线开关单元具有三个控制端, 其中两个控制端分别为高电平和低电平, 一 个控制端与 PCI 连接器连接, 当 PCI 连接器与 PCI 主机连接时 PCI 连接器输出低电平, 当 PCI 连接器与 PCI 主机断开时 PCI 连接器输出高电平, 从而用以控制总线开关单元与存储器 单元和 PCI 连接器通信的开断。
     本发明的有益效果是 : 由于本发明的解码器自身具有可以存储解码器的启动程 序的存储器单元, 而且具有控制制总线开关单元与存储器单元和 PCI 连接器通信的开断的 PCI 信号检测线, 因此本发明的解码器可以自动选择通过 PCI 主机调取驱动程序或者通过 调取自身存储器单元的驱动程序启动, 从而使解码器自成一个完整的模块, 可以单独进行 启动, 这样, 一旦 PCI 主机出现故障或者 PCI 驱动程序被破坏, 就可以把解码器从 PCI 主机 上取下, 在单独供电的情况下单独启动解码器, 从而可以单独对解码器进行调试或软件升 级, 以排除解码器本身的问题。 附图说明
     图 1 是本发明的具体实施例的结构原理图。
     图 2 是本发明的具体实施例内启动时的结构原理图。
     图 3 是本发明的具体实施例外启动时的结构原理图。
     图 4 是本发明的具体实施例总线开关单元的结构原理图。附图标记说明 : 处理器单元 1、 内存单元 2、 总线开关单元 3、 PCI 连接器 4、 存储器 单元 5、 电源单元 6。 具体实施方式
     下面结合附图和具体实施例对本发明做进一步的说明。 再对具体实施例进行说明 前, 先做如下基础性定义。
     本发明中解码器的启动模式被分为内启动和外启动两种模式, 当解码器从其自身 的存储器单元调取备份的解码器的驱动程序单独启动时被称为内启动, 当解码器通过 PCI 连接器从 PCI 主机中调取解码器的驱动程序启动时被称为外启动。
     另外, 本发明中高电平和低电平的定义是相对的, 如定义高电平为 5V, 低电平为 0V, 此时高电平和低电平相当于控制信号中的数字信号 “1” 和 “0” , 当然也可以将高电平和 低电平的具体数值进行调整或者将高电平和低电平对应的数字信号做相反定义, 这些情况 都不会被视为对本发明的保护范围的限制。
     如 图 1 所 示, 可 以 自 动 切 换 启 动 模 式 的 解 码 器 装 置, 包 括 处 理 器 单 元、 内存 单 元、 PCI 连 接 器、 总 线 开 关 单 元 和 存 储 器 单 元, 所 述 总 线 开 关 单 元 通 过 EMIFA 总 线 (Asynchronous ExternalMemory Interface, 异步外围存储器接口 ) 和处理器单元联结实 现通信, 通过 Flash 总线和存储器单元联结实现通信, 通过 PCI 总线和 PCI 连接器连接实现 通信, 所述 PCI 连接器引出有一根 PCI 信号检测线和总线开关单元连接用以控制总线开关 单元与存储器单元和 PCI 连接器通信的开断, 所述 PCI 信号检测线具有连接有电阻的高电 平端。 图中的处理器单元可以是具备 DDR(Double Data Rate SDRAM, 双倍速率同步动态 随机存储器 ) 专用接口的 DSP(Digital Signal Processor, 数字信号处理器 ) 或专用媒体 处理器, 该处理器单元还必须具备 EMIFA 总线接口 ; 内存单元可以是 DDR、 DDR2、 DDR3 等 ; 总 线开关单元的信号连通电阻需要小于 5Ω, 且信号的通道数不能低于 PCI 连接器的信号数 据总数, 总线开关单元推荐使用型号为 SN74CBT16214 或 SN74CBTLV16214 的总线开关, 该总 线开关有三位通路选择控制端, 可以切换 8 组信号的连接状态, 但是本实施例只需切换两 组信号的连接状态 ; 存储器单元可以是 NOR( 或非门 FLASH 存储器 ) 类型, 也可以是 NAND( 与 非门 FLASH 存储器 ) 类型。
     如图 4 所示为具体实施例总线开关单元的结构原理图, 所述总线开关单元具有三 个控制端 S0、 S1 和 S2, 其中两个控制端 S0 和 S1 分别为高电平和低电平, 一个控制端 S2 与 PCI 连接器连接, 当 PCI 连接器与 PCI 主机连接时 PCI 连接器输出低电平, 当 PCI 连接器与 PCI 主机断开时 PCI 连接器输出高电平, 从而用以控制总线开关单元与存储器单元和 PCI 连 接器通信的开断。
     图中出现的电源单元 6 可以不被视为本解码器装置的组成部分, 它用于向解码器 装置的各个组成单元输出各种电压, 本实施例中电源单元 6 的输入端分别接入 5V 电压和 12V 电压, 输入端输出分别输出 1.2V、 1.8V、 3.3V 或 5V 电压, 当外启动时输入 5V 电压, 内启 动时输入 12V 电压。
     由于在本实施例中只需切换两组信号的连接状态, 将处理器单元的控制端 S0 拉 高为高电平、 控制断 S1 拉低为低电平, 仅使用控制端 S2 一端就可以实现二选一开关控制,
     当 【S0S1S2】 = 100 时, EMIFA 总线侧与 PCI 侧连通 ; 当 【S0S1S2】 = 101 时, EMIFA 总线侧 与 Flash 总线侧连通。
     PCI 信号检测线连接到 PCI 连接器的一个地信号连接脚。 当解码器没有连接 PCI 主 机时, 该连接脚因上拉电阻 ( 此处电阻取值 1K Ω) 的电平上移作用呈现为高电平, 从而使 使处理器单元的控制端 S2 也为高电平 ; 另外, 当解码器连接 PCI 主机时, 该连接脚因主机上 PCI 插槽连接到地而使其电平下移为低电平, 从而使处理器单元的控制端 S2 为低电平。由 于采用上述原理, 使处理器单元的控制端 S2 的电平随着解码器连接 PCI 主机或不连接 PCI 主机而发生高电平和低电平即数字信号 0、 1 之间的逻辑改变, 从而解码器自动改变了启动 模式。
     如图 2 所示为实施例内启动时的结构原理图, 当解码器没有连接到 PCI 主机时, PCI 信号检测线连接的处理器单元的控制端 S2 也高电平, 此时, 总线开关单元将 EMIFA 总线 与 Flash 总线接通 ( 同时将 EMIFA 总线与 PCI 总线断开 ), 在电源和其它系统控制信号稳定 后, 解码器将自动从存储器单元加载解码器的启动程序, 引导主程序的运行。
     如图 3 所示为实施例外启动时的结构原理图, 当解码器连接到 PCI 主机时, PCI 信号检测线连接的处理器单元的控制端 S2 为低电平, 此时, 总线开关单元将 EMIFA 总线与 Flash 总线断开 ( 同时将 EMIFA 总线与 PCI 总线接通 ), 在电源和其它系统控制信号稳定后, 解码器将自动从 PCI 主机加载解码器的启动程序, 引导主程序的运行。
     本领域的普通技术人员将会意识到, 这里所述的实施例是为了帮助读者理解本发 明的原理, 应被理解为本发明的保护范围并不局限于这样的特别陈述和实施例。本领域的 普通技术人员可以根据本发明公开的这些技术启示做出各种不脱离本发明实质的其它各 种具体变形和组合, 这些变形和组合仍然在本发明的保护范围内。

可以自动切换启动模式的解码器装置.pdf_第1页
第1页 / 共7页
可以自动切换启动模式的解码器装置.pdf_第2页
第2页 / 共7页
可以自动切换启动模式的解码器装置.pdf_第3页
第3页 / 共7页
点击查看更多>>
资源描述

《可以自动切换启动模式的解码器装置.pdf》由会员分享,可在线阅读,更多相关《可以自动切换启动模式的解码器装置.pdf(7页珍藏版)》请在专利查询网上搜索。

1、10申请公布号CN101986277A43申请公布日20110316CN101986277ACN101986277A21申请号201010523541422申请日20101029G06F11/16200601H04N7/2620060171申请人成都九洲电子信息系统有限责任公司地址610041四川省成都市高新区天府大道中段765号72发明人王勤74专利代理机构电子科技大学专利中心51203代理人周永宏54发明名称可以自动切换启动模式的解码器装置57摘要本发明涉及可以自动切换启动模式的解码器装置,包括处理器单元、内存单元和PCI连接器,还包括总线开关单元和存储器单元,所述总线开关单元通过EMIF。

2、A总线和处理器单元联结实现通信,通过FLASH总线和存储器单元联结实现通信,通过PCI总线和PCI连接器连接实现通信,所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接用以控制总线开关单元与存储器单元和PCI连接器通信的开断,所述PCI信号检测线具有连接有电阻的高电平端。本发明的有益效果是在单独供电的情况下可以单独启动解码器,从而可以单独对解码器进行调试或软件升级,以排除解码器本身的问题。51INTCL19中华人民共和国国家知识产权局12发明专利申请权利要求书1页说明书3页附图2页CN101986278A1/1页21可以自动切换启动模式的解码器装置,包括处理器单元、内存单元和PCI连。

3、接器,其特征在于,还包括总线开关单元和存储器单元,所述总线开关单元通过EMIFA总线和处理器单元联结实现通信,通过FLASH总线和存储器单元联结实现通信,通过PCI总线和PCI连接器连接实现通信,所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接用以控制总线开关单元与存储器单元和PCI连接器通信的开断,所述PCI信号检测线具有连接有电阻的高电平端。2根据权利要求1所述的可以自动切换启动模式的解码器装置,所述总线开关单元具有三个控制端,其中两个控制端分别为高电平和低电平,一个控制端与PCI连接器连接,当PCI连接器与PCI主机连接时PCI连接器输出低电平,当PCI连接器与PCI主机断开。

4、时PCI连接器输出高电平,从而用以控制总线开关单元与存储器单元和PCI连接器通信的开断。权利要求书CN101986277ACN101986278A1/3页3可以自动切换启动模式的解码器装置技术领域0001本发明属于通信技术领域,尤其涉及解码器技术领域。背景技术0002解码器则包括视频解码器和音频解码器。目前,通常的解码器,一般将解码器的启动程序存放在PCIPERIPHERALCOMPONENTINTERCONNECT,外围组件互联接口标准主机的驱动程序中,而没有在解码器内部设置用于解码器的启动程序备份的存储器。这样,一旦PCI主机出现故障或者PCI驱动程序被破坏,解码器的启动程序将完全丢失,使。

5、解码器不能单独进行维修和调试。发明内容0003本发明的目的是为了克服现有的解码器不能单独启动的不足,提出了可以自动切换启动模式的解码器装置。0004本发明的技术方案是可以自动切换启动模式的解码器装置,包括处理器单元、内存单元和PCI连接器,其特征在于,还包括总线开关单元和存储器单元,所述总线开关单元通过EMIFA总线和处理器单元联结实现通信,通过FLASH总线和存储器单元联结实现通信,通过PCI总线和PCI连接器连接实现通信,所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接用以控制总线开关单元与存储器单元和PCI连接器通信的开断,所述PCI信号检测线具有连接有电阻的高电平端。000。

6、5所述总线开关单元具有三个控制端,其中两个控制端分别为高电平和低电平,一个控制端与PCI连接器连接,当PCI连接器与PCI主机连接时PCI连接器输出低电平,当PCI连接器与PCI主机断开时PCI连接器输出高电平,从而用以控制总线开关单元与存储器单元和PCI连接器通信的开断。0006本发明的有益效果是由于本发明的解码器自身具有可以存储解码器的启动程序的存储器单元,而且具有控制制总线开关单元与存储器单元和PCI连接器通信的开断的PCI信号检测线,因此本发明的解码器可以自动选择通过PCI主机调取驱动程序或者通过调取自身存储器单元的驱动程序启动,从而使解码器自成一个完整的模块,可以单独进行启动,这样,。

7、一旦PCI主机出现故障或者PCI驱动程序被破坏,就可以把解码器从PCI主机上取下,在单独供电的情况下单独启动解码器,从而可以单独对解码器进行调试或软件升级,以排除解码器本身的问题。附图说明0007图1是本发明的具体实施例的结构原理图。0008图2是本发明的具体实施例内启动时的结构原理图。0009图3是本发明的具体实施例外启动时的结构原理图。0010图4是本发明的具体实施例总线开关单元的结构原理图。说明书CN101986277ACN101986278A2/3页40011附图标记说明处理器单元1、内存单元2、总线开关单元3、PCI连接器4、存储器单元5、电源单元6。具体实施方式0012下面结合附图。

8、和具体实施例对本发明做进一步的说明。再对具体实施例进行说明前,先做如下基础性定义。0013本发明中解码器的启动模式被分为内启动和外启动两种模式,当解码器从其自身的存储器单元调取备份的解码器的驱动程序单独启动时被称为内启动,当解码器通过PCI连接器从PCI主机中调取解码器的驱动程序启动时被称为外启动。0014另外,本发明中高电平和低电平的定义是相对的,如定义高电平为5V,低电平为0V,此时高电平和低电平相当于控制信号中的数字信号“1”和“0”,当然也可以将高电平和低电平的具体数值进行调整或者将高电平和低电平对应的数字信号做相反定义,这些情况都不会被视为对本发明的保护范围的限制。0015如图1所示。

9、,可以自动切换启动模式的解码器装置,包括处理器单元、内存单元、PCI连接器、总线开关单元和存储器单元,所述总线开关单元通过EMIFA总线ASYNCHRONOUSEXTERNALMEMORYINTERFACE,异步外围存储器接口和处理器单元联结实现通信,通过FLASH总线和存储器单元联结实现通信,通过PCI总线和PCI连接器连接实现通信,所述PCI连接器引出有一根PCI信号检测线和总线开关单元连接用以控制总线开关单元与存储器单元和PCI连接器通信的开断,所述PCI信号检测线具有连接有电阻的高电平端。0016图中的处理器单元可以是具备DDRDOUBLEDATARATESDRAM,双倍速率同步动态随。

10、机存储器专用接口的DSPDIGITALSIGNALPROCESSOR,数字信号处理器或专用媒体处理器,该处理器单元还必须具备EMIFA总线接口;内存单元可以是DDR、DDR2、DDR3等;总线开关单元的信号连通电阻需要小于5,且信号的通道数不能低于PCI连接器的信号数据总数,总线开关单元推荐使用型号为SN74CBT16214或SN74CBTLV16214的总线开关,该总线开关有三位通路选择控制端,可以切换8组信号的连接状态,但是本实施例只需切换两组信号的连接状态;存储器单元可以是NOR或非门FLASH存储器类型,也可以是NAND与非门FLASH存储器类型。0017如图4所示为具体实施例总线开关。

11、单元的结构原理图,所述总线开关单元具有三个控制端S0、S1和S2,其中两个控制端S0和S1分别为高电平和低电平,一个控制端S2与PCI连接器连接,当PCI连接器与PCI主机连接时PCI连接器输出低电平,当PCI连接器与PCI主机断开时PCI连接器输出高电平,从而用以控制总线开关单元与存储器单元和PCI连接器通信的开断。0018图中出现的电源单元6可以不被视为本解码器装置的组成部分,它用于向解码器装置的各个组成单元输出各种电压,本实施例中电源单元6的输入端分别接入5V电压和12V电压,输入端输出分别输出12V、18V、33V或5V电压,当外启动时输入5V电压,内启动时输入12V电压。0019由于。

12、在本实施例中只需切换两组信号的连接状态,将处理器单元的控制端S0拉高为高电平、控制断S1拉低为低电平,仅使用控制端S2一端就可以实现二选一开关控制,说明书CN101986277ACN101986278A3/3页5当【S0S1S2】100时,EMIFA总线侧与PCI侧连通;当【S0S1S2】101时,EMIFA总线侧与FLASH总线侧连通。0020PCI信号检测线连接到PCI连接器的一个地信号连接脚。当解码器没有连接PCI主机时,该连接脚因上拉电阻此处电阻取值1K的电平上移作用呈现为高电平,从而使使处理器单元的控制端S2也为高电平;另外,当解码器连接PCI主机时,该连接脚因主机上PCI插槽连接到。

13、地而使其电平下移为低电平,从而使处理器单元的控制端S2为低电平。由于采用上述原理,使处理器单元的控制端S2的电平随着解码器连接PCI主机或不连接PCI主机而发生高电平和低电平即数字信号0、1之间的逻辑改变,从而解码器自动改变了启动模式。0021如图2所示为实施例内启动时的结构原理图,当解码器没有连接到PCI主机时,PCI信号检测线连接的处理器单元的控制端S2也高电平,此时,总线开关单元将EMIFA总线与FLASH总线接通同时将EMIFA总线与PCI总线断开,在电源和其它系统控制信号稳定后,解码器将自动从存储器单元加载解码器的启动程序,引导主程序的运行。0022如图3所示为实施例外启动时的结构原。

14、理图,当解码器连接到PCI主机时,PCI信号检测线连接的处理器单元的控制端S2为低电平,此时,总线开关单元将EMIFA总线与FLASH总线断开同时将EMIFA总线与PCI总线接通,在电源和其它系统控制信号稳定后,解码器将自动从PCI主机加载解码器的启动程序,引导主程序的运行。0023本领域的普通技术人员将会意识到,这里所述的实施例是为了帮助读者理解本发明的原理,应被理解为本发明的保护范围并不局限于这样的特别陈述和实施例。本领域的普通技术人员可以根据本发明公开的这些技术启示做出各种不脱离本发明实质的其它各种具体变形和组合,这些变形和组合仍然在本发明的保护范围内。说明书CN101986277ACN101986278A1/2页6图1图2说明书附图CN101986277ACN101986278A2/2页7图3图4说明书附图CN101986277A。

展开阅读全文
相关资源
猜你喜欢
相关搜索

当前位置:首页 > 物理 > 计算;推算;计数


copyright@ 2017-2020 zhuanlichaxun.net网站版权所有
经营许可证编号:粤ICP备2021068784号-1